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LP2998

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シャットダウン・ピン採用、1.5A DDR 終端レギュレータ

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製品詳細

Vin (min) (V) 1.35 Vin (max) (V) 5.5 Vout (min) (V) 0.656 Vout (max) (V) 0.698 Features Shutdown Pin for S3 Rating Catalog Operating temperature range (°C) -40 to 125 Iq (typ) (mA) 0.32 Product type DDR DDR memory type DDR, DDR2, DDR3, DDR3L
Vin (min) (V) 1.35 Vin (max) (V) 5.5 Vout (min) (V) 0.656 Vout (max) (V) 0.698 Features Shutdown Pin for S3 Rating Catalog Operating temperature range (°C) -40 to 125 Iq (typ) (mA) 0.32 Product type DDR DDR memory type DDR, DDR2, DDR3, DDR3L
HSOIC (DDA) 8 29.4 mm² 4.9 x 6 SOIC (D) 8 29.4 mm² 4.9 x 6
  • 電流ソースおよび電流シンク
  • 低出力電圧オフセット
  • 外付け抵抗不要
  • リニア・トポロジー
  • Suspend-to-RAM (STR) 機能
  • 少ない外付け部品
  • サーマル・シャットダウン
  • SO-8、PSOP-8 パッケージで供給
  • 電流ソースおよび電流シンク
  • 低出力電圧オフセット
  • 外付け抵抗不要
  • リニア・トポロジー
  • Suspend-to-RAM (STR) 機能
  • 少ない外付け部品
  • サーマル・シャットダウン
  • SO-8、PSOP-8 パッケージで供給

LP2998 はJEDEC 標準のSSTL-2、SSTL-18 仕様に適合するDDR-SDRAM、DDR-II メモリのターミネーションのリニア・レギュ レータです。LP2998 は負荷変動に対して優れた応答を発揮する高速オペアンプを内蔵しています。出力段は貫通電流を防ぐよう に設計されており、DDR-I-SDRAMターミネーションに求められる1.5A の連続電流出力と、DDR-II-SDRAMターミネーションに求 められる0.5A の連続電流出力を実現しています。VSENSE ピンを介した電圧監視により優れた出力負荷レギュレーションを実現 するとともに、チップセットやDIMM に必要なVREF 電圧も生成して出力します。

このほかLP2998 は、Suspend-to-RAM (STR) 機能をサポートするアクティブLOW のシャットダウン(SD) ピンを備えています。SD をLow にすると、VTT 出力はTRI-STATE のハイ・インピーダンスとなりますが、VREF はアクティブを保ちます。本モードでは待機時 消費電流が小さくなるため、電力節減を図れます。

LP2998 はJEDEC 標準のSSTL-2、SSTL-18 仕様に適合するDDR-SDRAM、DDR-II メモリのターミネーションのリニア・レギュ レータです。LP2998 は負荷変動に対して優れた応答を発揮する高速オペアンプを内蔵しています。出力段は貫通電流を防ぐよう に設計されており、DDR-I-SDRAMターミネーションに求められる1.5A の連続電流出力と、DDR-II-SDRAMターミネーションに求 められる0.5A の連続電流出力を実現しています。VSENSE ピンを介した電圧監視により優れた出力負荷レギュレーションを実現 するとともに、チップセットやDIMM に必要なVREF 電圧も生成して出力します。

このほかLP2998 は、Suspend-to-RAM (STR) 機能をサポートするアクティブLOW のシャットダウン(SD) ピンを備えています。SD をLow にすると、VTT 出力はTRI-STATE のハイ・インピーダンスとなりますが、VREF はアクティブを保ちます。本モードでは待機時 消費電流が小さくなるため、電力節減を図れます。
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技術資料

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* データシート LP2998 DDR- Ⅱ /DDR- Ⅰターミネーション・レギュレータ データシート (Rev. G 翻訳版) 最新英語版 (Rev.K) PDF | HTML 2011年 3月 28日
アプリケーション・ノート DDR VTT Power Solutions: A Competitive Analysis (Rev. A) 2020年 7月 9日
アプリケーション・ノート Limiting DDR Termination Regulators’ Inrush Current 2016年 8月 23日
EVM ユーザー ガイド (英語) AN-1813 LP2998 Evaluation Board (Rev. A) 2013年 5月 7日
アプリケーション・ノート AN-1254 DDR-SDRAM Termination Simplified Using a Linear Regulator (Rev. A) 2013年 5月 6日
アプリケーション・ノート Pwr Ref Design f/'C6472 12-Vin Digital Pwr Controllers and LDOs 2010年 4月 28日
アプリケーション・ノート Power Two Xilinx(TM) LX240 Virtex-6(TM) Devices 2010年 4月 20日
アプリケーション・ノート Power Ref Design for TMS320C6472 5Vin DC/DC Converters (1x C6472) 2010年 3月 31日
アプリケーション・ノート 'C6472 12Vin Flexible Pwr Design Using DCDC Controllers and LDOs (8x C6472) 2010年 3月 26日
アプリケーション・ノート Power Reference Design for the 'C6472, 12V DCDC Controllers, and LDOs 2010年 3月 26日
アプリケーション・ノート TMS320C6472 5V Input Pwr Design, Integrated FET DC/DC Converters and Controllers 2010年 3月 26日

設計および開発

その他のアイテムや必要なリソースを参照するには、以下のタイトルをクリックして詳細ページをご覧ください。

評価ボード

LP2998EVAL — LP2998 評価ボード

The LP2998 evaluation board is designed to provide the design Engineer with a fully functional prototype system in which to evaluate the LP2998 in both a static environment and with a complete memory system.

ユーザー ガイド: PDF
TI.com で取り扱いなし
シミュレーション・モデル

LP2998 PSPICE Transient Model (Rev. B)

SNVM695B.ZIP (48 KB) - PSpice Model
ダウンロード
シミュレーション・モデル

LP2998 TINA-TI Transient Reference Design

SNVMB49.TSC (599 KB) - TINA-TI Reference Design
ダウンロード
シミュレーション・モデル

LP2998 TINA-TI Transient Spice Model

SNVMB48.ZIP (39 KB) - TINA-TI Spice Model
ダウンロード
シミュレーション・モデル

LP2998 Unencrypted PSpice Model

SNVMAF5.ZIP (7 KB) - PSpice Model
ダウンロード
リファレンス・デザイン

TIDA-010011 — 保護リレー プロセッサ モジュール向け高効率電源アーキテクチャのリファレンス デザイン

このリファレンス デザインでは、1A を超える負荷電流と高い効率を必要とするアプリケーション プロセッサ モジュール向けに複数の電圧レールを生成する、各種の電源アーキテクチャを紹介します。必要な電力は、バックプレーンからの5、12、24V DC入力を使用して供給します。小型化のためFET内蔵のDC-DCコンバータとインダクタ内蔵の電源モジュールを使用して電力を供給します。このデザインでは、低 EMI を必要とするアプリケーション向けに HotRod™ パッケージ (...)
回路図: PDF
リファレンス・デザイン

PMP10600 — Xilinx® Zynq®7000 シリーズ（XC7Z015）電源ソリューション、5W - リファレンス・デザイン

PMP10600.1 リファレンス・デザインでは、Xilinx® 製 Zynq® 7000 シリーズ（XC7Z015）の FPGA に電力を供給するために必要とされるすべての電源レールを実装できます。  このデザインでは、複数の LMZ3 シリーズ・モジュール、複数の LDO、1 つの DDR 終端レギュレータを採用しています。  また、パワーアップ/ダウン・シーケンシングを実行する 1 個の LM3880 を採用しています。  このリファレンス・デザインでは、12V 入力を使用します。
試験報告書: PDF
回路図: PDF
リファレンス・デザイン

PMP10601 — Xilinx® Zynq® 7000 シリーズ（XC7Z015）電源ソリューション、8W - リファレンス・デザイン

PMP10601 リファレンス・デザインでは、Xilinx® 製 Zynq® 7000 シリーズ（XC7Z015）の FPGA に電力を供給するために必要とされるすべての電源レールを実装できます。  このデザインでは、複数の LMZ3 シリーズ・モジュール、複数の LDO、1 つの DDR 終端レギュレータを採用しており、FPGA に電力を供給するために必要とされるすべてのレールを実装できます。 また、パワーアップ/ダウン・シーケンシングを実行する 1 個の LM3880 を採用しています。 このリファレンス・デザインでは、12V 入力を使用します。
試験報告書: PDF
回路図: PDF
リファレンス・デザイン

PMP9766 — スーパーキャパシタ用バックアップ電源、アクティブ・セル・バランシング付、リファレンス・デザイン

This reference design describes a backup power circuit which addresses instantaneous protection against power interruptions by using a buck-boost converter and two stacked supercapacitors. The implementation is based on a completely integrated TPS63020 buck-boost converter circuit enabling a small (...)
試験報告書: PDF
回路図: PDF
リファレンス・デザイン

PMP10630 — Xilinx Kintex UltraScale XCKU040 FPGA 電源ソリューション、6W、リファレンス・デザイン

PMP10630 は、Xilinx® Kintex® UltraScale™ XCKU040 FPGA 向けの包括的な高密度パワー・ソリューションを実現するリファレンス・デザインです。このリファレンス・デザインは、SIMPLE SWITCHER® モジュールと複数の LDO を組み合わせており、36 x 43mm（1.4 x 1.7 インチ）の小型ソリューション・サイズで、必要な電圧レールすべてを提供します。このリファレンス・デザインは、LMZ31704 LMZ3 シリーズのモジュールを搭載し、コア・レールと 3 個の LMZ21700/1 (...)
試験報告書: PDF
回路図: PDF
パッケージ ピン数 CAD シンボル、フットプリント、および 3D モデル
HSOIC (DDA) 8 Ultra Librarian
SOIC (D) 8 Ultra Librarian
TI の評価品に関する標準契約約款が適用されます。

購入と品質

記載されている情報：
  • RoHS
  • REACH
  • デバイスのマーキング
  • リード端子の仕上げ / ボールの原材料
  • MSL 定格 / ピーク リフロー
  • MTBF/FIT 推定値
  • 使用原材料
  • 認定試験結果
  • 継続的な信頼性モニタ試験結果
記載されている情報：
  • ファブの拠点
  • 組み立てを実施した拠点

推奨製品には、この TI 製品に関連するパラメータ、評価基板、またはリファレンス デザインが存在する可能性があります。

サポートとトレーニング

TI E2E™ フォーラムでは、TI のエンジニアからの技術サポートを提供

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