Available in the Texas Instruments
NanoFree™ Package
Supports 5-V V_CC Operation
Inputs Accept Voltages to 5.5 V
Supports Down Translation to V_CC
Maximum t_pd of 4 ns at 3.3 V
Low Power Consumption, 10-µA Maximum I_CC
±24-mA Output Drive at 3.3 V
V_OLP (Output Ground Bounce)
<0.8 V Typical at V_CC = 3.3 V, T_A = 25°C
V_OHV (Output V_OH Undershoot)
>2 V Typical at V_CC = 3.3 V, T_A = 25°C
I_off Supports Live Insertion, Partial-Power-Down
Mode, and Back-Drive Protection
Latch-Up Performance Exceeds 100 mA Per
JESD 78, Class II
ESD Protection Exceeds JESD 22
- 2000-V Human Body Model (A114-A)
- 200-V Machine Model (A115-A)
- 1000-V Charged-Device Model (C101)

Available in the Texas Instruments
NanoFree™ Package
Supports 5-V V_CC Operation
Inputs Accept Voltages to 5.5 V
Supports Down Translation to V_CC
Maximum t_pd of 4 ns at 3.3 V
Low Power Consumption, 10-µA Maximum I_CC
±24-mA Output Drive at 3.3 V
V_OLP (Output Ground Bounce)
<0.8 V Typical at V_CC = 3.3 V, T_A = 25°C
V_OHV (Output V_OH Undershoot)
>2 V Typical at V_CC = 3.3 V, T_A = 25°C
I_off Supports Live Insertion, Partial-Power-Down
Mode, and Back-Drive Protection
Latch-Up Performance Exceeds 100 mA Per
JESD 78, Class II
ESD Protection Exceeds JESD 22
- 2000-V Human Body Model (A114-A)
- 200-V Machine Model (A115-A)
- 1000-V Charged-Device Model (C101)

This decoder/demultiplexer is designed for 1.65-V to 5.5-V V_CC operation.

The SN74LVC1G19 device is a 1-of-2 decoder / demultiplexer. When E input is high, the decoder will be disabled and both outputs will be high. When E input is low, the A input selects which output will be low.

This device is fully specified for partial-power-down applications using I_off.

This decoder/demultiplexer is designed for 1.65-V to 5.5-V V_CC operation.

This device is fully specified for partial-power-down applications using I_off.

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技術資料

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	種類	タイトル		最新の英語版をダウンロード	日付
*	データシート	SN74LVC1G19 1-of-2 Decoder and Demultiplexer データシート (Rev. G)	PDF \| HTML		2015年 8月 31日
	アプリケーション・ノート	Implications of Slow or Floating CMOS Inputs (Rev. E)			2021年 7月 26日
	セレクション・ガイド	Little Logic Guide 2018 (Rev. G)			2018年 7月 6日
	セレクション・ガイド	Logic Guide (Rev. AB)			2017年 6月 12日
	アプリケーション・ノート	How to Select Little Logic (Rev. A)			2016年 7月 26日
	アプリケーション・ノート	Understanding and Interpreting Standard-Logic Data Sheets (Rev. C)			2015年 12月 2日
	セレクション・ガイド	ロジック・ガイド (Rev. AA 翻訳版)		最新英語版 (Rev.AB)	2014年 11月 6日
	ユーザー・ガイド	LOGIC Pocket Data Book (Rev. B)			2007年 1月 16日
	製品概要	Design Summary for WCSP Little Logic (Rev. B)			2004年 11月 4日
	アプリケーション・ノート	Semiconductor Packing Material Electrostatic Discharge (ESD) Protection			2004年 7月 8日
	アプリケーション・ノート	Selecting the Right Level Translation Solution (Rev. A)			2004年 6月 22日
	ユーザー・ガイド	Signal Switch Data Book (Rev. A)			2003年 11月 14日
	アプリケーション・ノート	Use of the CMOS Unbuffered Inverter in Oscillator Circuits			2003年 11月 6日
	ユーザー・ガイド	LVC and LV Low-Voltage CMOS Logic Data Book (Rev. B)			2002年 12月 18日
	アプリケーション・ノート	Texas Instruments Little Logic Application Report			2002年 11月 1日
	アプリケーション・ノート	TI IBIS File Creation, Validation, and Distribution Processes			2002年 8月 29日
	その他の技術資料	Standard Linear & Logic for PCs, Servers & Motherboards			2002年 6月 13日
	アプリケーション・ノート	16-Bit Widebus Logic Families in 56-Ball, 0.65-mm Pitch Very Thin Fine-Pitch BGA (Rev. B)			2002年 5月 22日
	アプリケーション・ノート	Power-Up 3-State (PU3S) Circuits in TI Standard Logic Devices			2002年 5月 10日
	その他の技術資料	STANDARD LINEAR AND LOGIC FOR DVD/VCD PLAYERS			2002年 3月 27日
	アプリケーション・ノート	Migration From 3.3-V To 2.5-V Power Supplies For Logic Devices			1997年 12月 1日
	アプリケーション・ノート	Bus-Interface Devices With Output-Damping Resistors Or Reduced-Drive Outputs (Rev. A)			1997年 8月 1日
	アプリケーション・ノート	CMOS Power Consumption and CPD Calculation (Rev. B)			1997年 6月 1日
	アプリケーション・ノート	LVC Characterization Information			1996年 12月 1日
	アプリケーション・ノート	Input and Output Characteristics of Digital Integrated Circuits			1996年 10月 1日
	アプリケーション・ノート	Live Insertion			1996年 10月 1日
	設計ガイド	Low-Voltage Logic (LVC) Designer's Guide			1996年 9月 1日
	アプリケーション・ノート	Understanding Advanced Bus-Interface Products Design Guide			1996年 5月 1日

設計および開発

その他のアイテムや必要なリソースを参照するには、以下のタイトルをクリックして詳細ページをご覧ください。

評価ボード

5-8-LOGIC-EVM — 5 ～ 8 ピンの DCK、DCT、DCU、DRL、DBV の各パッケージをサポートする汎用ロジックの評価基板 (EVM)

5 ～ 8 ピンで DCK、DCT、DCU、DRL、DBV の各パッケージを使用する多様なデバイスをサポートできる設計のフレキシブルな評価基板です。

ユーザーガイド: PDF

TI.com で取り扱いなし

シミュレーション・モデル

SN74LVC1G19 IBIS Model (Rev. A)

SCEM356A.ZIP (43 KB) - IBIS Model

ダウンロード

リファレンス・デザイン

TIDA-00751 — ソリッド・ステート・リレー 24V AC スイッチ、ガルバニック絶縁付、リファレンス・デザイン

ソリッド・ステート・リレー 24V AC スイッチのリファレンス・デザインは、単一リレーの代替を可能にします。効率的で、低消費電力パワー・マネジメント性能により、標準的な電磁リレーに代わる選択肢を提供します。 OFF モードではシステム・コントローラに電力を供給します。また、ON モードでは電磁リレーでは不可能な高速切り替えにより、バックアップ・バッテリ充電を可能にします。内部トランスは絶縁を可能にします。また、電圧マルチプライヤは十分な電流の供給を確保し、システムの他の部分で使われているリレーの制御を可能にします。

設計ガイド: PDF

回路図: PDF

リファレンス・デザイン

TIDA-01552 — デジタル出力モジュール向け 8 チャネル、2A ハイサイド・ドライバのリファレンス・デザイン

TIDA-01552 は PLC などのファクトリ・オートメーション・アプリケーションに対応した 8 チャネル、並列、2A、ハイサイド、デジタル出力のリファレンス・デザインで、TI の新しいハイサイド・ドライバ（TPS27S100 など）の診断機能と電力密度を活用しています。各出力は出力電流をリアルタイムで個別に測定できます。この機能により、動作中のワイヤの断線や回路の短絡を検出できます。経年劣化や改ざんに起因する出力負荷の変化も検出可能です。

設計ガイド: PDF

回路図: PDF

パッケージ	ピン数	CAD シンボル、フットプリント、および 3D モデル
DSBGA (YZP)	6	Ultra Librarian
SOT-23 (DBV)	6	Ultra Librarian
SOT-5X3 (DRL)	6	Ultra Librarian
SOT-SC70 (DCK)	6	Ultra Librarian
USON (DRY)	6	Ultra Librarian

TI の評価品に関する標準契約約款が適用されます。

購入と品質

記載されている情報：

RoHS
REACH
デバイスのマーキング
リード端子の仕上げ / ボールの原材料
MSL 定格 / ピークリフロー
MTBF/FIT 推定値
使用原材料
認定試験結果
継続的な信頼性モニタ試験結果

記載されている情報：

ファブの拠点
組み立てを実施した拠点

サポートとトレーニング

TI E2E™ フォーラムでは、TI のエンジニアからの技術サポートを提供

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