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SN74AHCT1G86

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TTL 互換 CMOS 入力、シングル、2 入力、4.5V ～ 5.5V XOR (排他 OR) ゲート

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SN74AHCT1G86

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製品詳細

Technology family AHCT Supply voltage (min) (V) 4.5 Supply voltage (max) (V) 5.5 Number of channels 1 Inputs per channel 2 IOL (max) (mA) 8 Input type TTL-Compatible CMOS IOH (max) (mA) -8 Output type Push-Pull Features Over-voltage tolerant inputs, Very high speed (tpd 5-10ns) Data rate (max) (Mbps) 70 Rating Catalog Operating temperature range (°C) -40 to 125
Technology family AHCT Supply voltage (min) (V) 4.5 Supply voltage (max) (V) 5.5 Number of channels 1 Inputs per channel 2 IOL (max) (mA) 8 Input type TTL-Compatible CMOS IOH (max) (mA) -8 Output type Push-Pull Features Over-voltage tolerant inputs, Very high speed (tpd 5-10ns) Data rate (max) (Mbps) 70 Rating Catalog Operating temperature range (°C) -40 to 125
SOT-23 (DBV) 5 8.12 mm² 2.9 x 2.8 SOT-SC70 (DCK) 5 4.2 mm² 2 x 2.1
  • 動作範囲：4.5V～5.5V
  • 最大 tpd：8ns (5V 時)
  • 低消費電力、ICC の最大値 10A
  • 5V で 8mA の出力駆動能力
  • 入力は TTL 電圧互換
  • JESD 17 準拠で 250mA 超のラッチアップ性能
  • 動作範囲：4.5V～5.5V
  • 最大 tpd：8ns (5V 時)
  • 低消費電力、ICC の最大値 10A
  • 5V で 8mA の出力駆動能力
  • 入力は TTL 電圧互換
  • JESD 17 準拠で 250mA 超のラッチアップ性能

SN74AHCT1G86 はシングル 2 入力排他 OR ゲートです。ブール関数 Y = A ⊕ B、つまり Y = AB + A B を正論理で実行します。

SN74AHCT1G86 はシングル 2 入力排他 OR ゲートです。ブール関数 Y = A ⊕ B、つまり Y = AB + A B を正論理で実行します。
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技術資料

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* データシート SN74AHCT1G86 シングル 2 入力排他 OR ゲート データシート (Rev. P 翻訳版) PDF | HTML 英語版 (Rev.P) PDF | HTML 2024年 2月 14日
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アプリケーション・ノート Bus-Interface Devices With Output-Damping Resistors Or Reduced-Drive Outputs (Rev. A) 1997年 8月 1日
アプリケーション・ノート CMOS Power Consumption and CPD Calculation (Rev. B) 1997年 6月 1日
アプリケーション・ノート Live Insertion 1996年 10月 1日

設計および開発

その他のアイテムや必要なリソースを参照するには、以下のタイトルをクリックして詳細ページをご覧ください。

評価ボード

5-8-LOGIC-EVM — 5 ～ 8 ピンの DCK、DCT、DCU、DRL、DBV の各パッケージをサポートする汎用ロジックの評価基板 (EVM)

5 ～ 8 ピンで DCK、DCT、DCU、DRL、DBV の各パッケージを使用する多様なデバイスをサポートできる設計のフレキシブルな評価基板です。
ユーザー ガイド: PDF
TI.com で取り扱いなし
シミュレーション・モデル

SN74AHC1G86 IBIS Model

SCLM017.ZIP (7 KB) - IBIS Model
ダウンロード
シミュレーション・モデル

SN74AHCT1G86 Behavioral SPICE Model

SCLM242.ZIP (7 KB) - PSpice Model
ダウンロード
リファレンス・デザイン

TIDA-010040 — アラーム・トーン・ジェネレータのリファレンス・デザイン

This reference design provides a way of generating alarms similar to as described in the IEC60601-1-8 standard for medical devices. The critical timing parameters are programmable through firmware. All parameters, including pulse width, pulse rate, internal frequency, pulse rise time, volume (...)
設計ガイド: PDF
回路図: PDF
パッケージ ピン数 CAD シンボル、フットプリント、および 3D モデル
SOT-23 (DBV) 5 Ultra Librarian
SOT-SC70 (DCK) 5 Ultra Librarian
TI の評価品に関する標準契約約款が適用されます。

購入と品質

記載されている情報：
  • RoHS
  • REACH
  • デバイスのマーキング
  • リード端子の仕上げ / ボールの原材料
  • MSL 定格 / ピーク リフロー
  • MTBF/FIT 推定値
  • 使用原材料
  • 認定試験結果
  • 継続的な信頼性モニタ試験結果
記載されている情報：
  • ファブの拠点
  • 組み立てを実施した拠点

サポートとトレーニング

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